適用於PCIe的Intel® FPGA IP
PCI Express（PCIe*）通訊協定是一種高效能、可擴充且功能豐富的序列通訊協定，資料傳輸速率從每秒 2.5 Gigatransfer（GT/s）到 32 GT/s 甚至更高。隨著 PCI-SIG 組織推出新一代規格，Intel® FPGA Intellectual Property (IP) for PCIe 持續擴大規模。Intel 自 1992 年以來一直是 PCI-SIG 的成員，隨著每一代矽晶片的推出，Intel 都會繼續參加 PCI-SIG 合規研討會（PCI-SIG Compliance Workshop），以確保互通性及符合目前的業界標準。
適用於PCIe的Intel® FPGA IP
PCIe IP 解決方案包括 Intel 的 PCIe 強化通訊協定堆疊，其中包括事務層與資料連結層，以及強化的實體層。後者同時包括實體媒體附接（PMA）與實體編碼次層（PCS）。Intel 的 PCIe IP 組合方案還包括可選 Soft IP 區塊，例如直接記憶體存取（DMA）引擎及 PCIe Switch。這樣獨特的強化和軟性 IP 的組合，提供卓越的效能與彈性，實現最佳的整合。
Intel 提供的 Intel FPGA® IP 功能型 PCIe IP 解決方案，透過 PCI-SIG 的通訊協定藍圖不斷演進。
- 透過 GTS PCIe 硬 IP 支援高達 PCIe 4.0 x8 ›
- 透過 R-Tile PCIe Hard IP 支援高達 PCIe 5.0 x16 ›
- 透過 F-Tile PCIe Hard IP 支援高達 PCIe 4.0 x16 & 400G 乙太網路 ›
- 透過 P-Tile PCIe 硬 IP 支援高達 PCIe 4.0 x16 ›
- 透過 L/H-Tile PCIe 硬 IP 支援高達 PCIe 3.0 x16 ›
- 在 Arria® 10 和 Cyclone® 10 裝置上支持高達 3x8 的硬 IP ›
Intel 還提供輔助軟 IP，可搭配上述 PCIe Hard IP 執行 PCIe DMA 與交換器功能。
- Agilex™ 7 FPGA – AXI 多通道 DMA IP（AXI-STREAM 介面）可用於補充 R-Tile PCIe 硬 IP ›
- Agilex™ 7 與 Stratix® 10 FPGAs – 多通道 DMA IP（AVMM / AVST 介面）可用於補充 H-Tile （Stratix® 10）/P-Tile/F-Tile/R-Tile PCIe Hard IP ›
- 可擴充的PCIe交換器IP可用於補充 P-Tile/F-Tile/R-Tile PCIe 硬IP ›
- 如需進一步瞭解 Agilex™ 5 FPGA – AXI 多通道 DMA IP（AXI-STREAM 介面）可作為 GTS PCIe Hard IP 的補充，請聯絡您當地的銷售代表。
裝置支援與 PCIe IP 區塊的數量
裝置系列 |
PCIe IP 區塊數量 |
PCIe 連結速度 1.0 (2.5 GT/s) |
PCIe 連結速度 2.0 （5.0 GT/s） |
PCIe 連結速度 3.0 （8.0 GT/s） |
PCIe 連結速度 4.0 （16.0 GT/s） |
PCIe 連結速度 5.0 （32.0 GT/s） |
|---|---|---|---|---|---|---|
Agilex™ 7 |
每個裝置 1–4 個 |
✓ |
✓ |
✓ |
✓ |
✓ |
| Agilex™ 5 | 每部裝置 1 - 4 | ✓ | ✓ | ✓ | ✓ | |
Stratix® 10 |
每個裝置 1–4 個 |
✓ |
✓ |
✓ |
✓ |
|
10 |
每個裝置 1–4 個 |
✓ |
✓ |
✓ |
|
|
Cyclone® 10 |
每個裝置 1 個 |
✓ |
✓ |
|
|
|
Cyclone® 10 GX |
每個裝置 1 個 |
✓ |
✓ |
|
|
|
Arria® V |
每個裝置 1–2 個 |
✓ |
✓ |
|
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|
Cyclone® V GT |
每個裝置 2 個 |
✓ |
✓ |
|
|
|
Cyclone® V GX |
每個裝置 1–2 個 |
✓ |
|
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|
Stratix® IV |
每個裝置 2–4 個 |
✓ |
✓ |
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|
Cyclone® IV GX |
每個裝置 1 個 |
✓ |
|
|
|
|
Arria® II GZ |
每個裝置 1 個 |
✓ |
✓ |
|
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|
Arria® II GX |
每個裝置 1 個 |
✓ |
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